期刊文章详细信息
文献类型:期刊文章
机构地区:[1]南昌航空大学信息工程学院通信工程系,江西南昌330063
年 份:2012
卷 号:9
期 号:24
起止页码:6-7
语 种:中文
收录情况:JST、普通刊
摘 要:本文分析了DDS与PLL的工作原理和基本结构,提出以DDS直接激励PLL的频率合成方法,给出了DDS模块、PLL模块和控制单元模块的硬件选择和具体电路设计方法。通过在EDA软件环境下进行设计及仿真,最终利用EPM570T100C、AD9910、ADF4113和ROS-1250W等芯片完成了跳频信号源硬件电路设计。经测试分析,DDS+PLL的频率合成器可输出840~960MHz、频率分辨力小于1Hz的频率信号,适用于高速跳频通信系统。
关 键 词:DDS PLL CPLD 滤波器
分 类 号:TP393]
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